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PDフリー積層バスバー:電界緩和・ボイド・重要な試験限界

部分放電を起こさない設計。界面のボイド管理、電界集中の緩和、10 pCレベルの試験限界と合否判定を解説する。

By SHANYUAN Materials Engineering Team 高電圧設計 Technical Note

部分放電を起こさない設計。界面のボイド管理、電界集中の緩和、10 pCレベルの試験限界と合否判定を解説する。

1. What Partial Discharge Is, in One Paragraph

部分放電(PD)は、絶縁ギャップ全体をブリッジしない局所的電気絶縁破壊。それはボイド内、導体縁、または局部界が材料耐量を超える表面で起こり、各サイクルでエネルギーを絶縁に堆積させる。月年を重ねると、その繰返し侵食が健全な誘電体をトラッキングされた導電性故障経路へ変える。

PD はピコクーロン(pC)で測定される。固体絶縁に対する業界経験則:開始は定格動作電圧で 10 pC 未満に抑制されるべきであり、中圧 Duty に対し、最新仕様は定格電圧で <10 pC を一般に要求する(バスバー絶縁体実務、2026)。

2. Where Voids Come From in a Laminate

積層バスバーは銅層と誘電体フィルムを積層し、熱と圧力で接着して作られる。問題となるボイドは三箇所で生まれる:レイアップ中のフィルム層間閉じ込め空気、接着サイクル中の溶剤・水分アウトガス、ラミネート圧がより低いフィルム縁のマイクロギャップ。

真空支援ラミネーションはまさに最初の二つを殺すために存在する。スタックが真空下で接着されると、空気の隠れ場所がなくなり、結果はより緻密でボイドフリーな界面。それが、MV コンバータ向け高電圧バス構造が真空ラミネーションを不可欠工程とする理由(CPES Virginia Tech、2020)。

3. Why Air Is the Weakest Link in the Stack

空気は大気圧で約 3 kV/mm の絶縁破壊強さを持ち、PET・Nomex・エポキシ絶縁が担う 15–30 kV/mm を一桁下回る。ボイドはしたがって誘電体装甲の穴:界がそこに集中し、空気が最初に破壊し、放電がゆっくり周囲材料を食う。

ボイドは小さいため破壊は部分的――hipot をトリップしないが、持続的。これが、同一誘電体スタックを持つ二つの積層体が全く異なる寿命を持ちうる理由:一方はボイドフリー、他方はそうでなく、PD 試験だけがそれらを区別する。

4. Field Grading: Moving the Peak Where the Material Can Hold It

PD は最高電圧で始まらず――最高界集中で始まる。平面バスでは、界が導体縁、めっき・無めっきスルーホール、表面実装パッドに集中する(CPES Virginia Tech、2020)。界調整はそのピークを空気から、より破壊強さの高い誘電体へ移す。

実務ツールボックス:導体を内部層に埋設し、ピーク E 界を制御された平面へ移すシールド層、縁で等電位分布を形作る調整プレートまたはパターン。ある 10 kV モジュール設計では、PCB 内部の銅トレースが界調整プレートとして使われ、ピーク界を空気から FR4 へ移し、11.6 kV rms で PD フリー運転を達成した(CPES Virginia Tech、2021)。

5. The Triple Point: Where Three Materials Meet

任意のバスバーで最もリスクの高い形状は三重点――導体・絶縁・第三媒体(通常空気またはポッティング)が出会う箇所。端子では、界が金属・フィルム・空気の接合部に集中しうり、表面放電がバルク絶縁がストレスを受けるずっと前にそこで始まる。

三つの対策が支配的:導電性または半導電層で三重点をシールドしピークを絶縁内へ移す;フィルム延長またはスリーブで沿面経路を延長;終端で鋭い金属縁を避ける。第二・第三は純粋な形状;第一は早い設計決定を要する。シールド層がスタック全体を変えるから。

Laminated busbar cutaway showing dielectric stack layers and field grading at conductor edges

6. Edges and Corners: Radius Is a PD Decision

鋭い角での界増強は半径にほぼ比例:刃先は界を平均応力の数倍に集中させ、丸み縁はそれを劇的に下げる。ラミネート設計では、導体の縁プロファイルは打抜き段階で設定され、後から絶縁で修正できない。

実務指針:見積り前に銅に最小縁半径を指定し、打抜バリを図面でチェック――バリは内蔵 PD 源。高電圧 Duty には、フィルム縁を導体縁を超えて延長し、境界で空気でなく誘電体が応力を受けるよう考慮されたい。

7. DC vs AC Partial Discharge

DC ストレス下の PD 試験は AC と挙動が異なる。AC 下ではボイドがサイクルあたり二回放電;DC 下では放電繰返し率がボイド内電荷緩和に依存し、しばしばはるかに低く、DC PD を検出困難にし過小評価しやすくする。

コンバータ・ESS DC リンクバスバーはしたがって、配電実務から継承した AC 試験だけでなく、特に DC PD 試験を要する。16 kV 定格平面バスが 18 kV DC まで PD フリーであることが実証され、DC 極間 PDIV は 20 kV と測定された(CPES Virginia Tech、2020)――インバータ Duty に関連するのは DC 試験。

8. PDIV and PDEV: The Two Numbers to Ask For

試験シートで重要な数値は二つ。PDIV(部分放電開始電圧)は、電圧上昇時に放電が最初に現れる電圧。PDEV(部分放電消滅電圧)は、電圧降下時に放電が止む電圧。それらの間のギャップはヒステリシス:8 kV で放電開始する材料が 5 kV まで放電を続けることがあり、電圧低下を見るシステムには消滅が重要。

バスバーを仕様化するときは、両方を IEC 60270 に従い試験し、背景雑音床を述べて求められたい。PDIV だけを引用する供給業者は、物語の半分しか語っていない。

9. The 10 pC Limit and How It Is Tested

定格電圧での <10 pC 目標は、魔法の数値でなく実務的閾値――健全な絶縁完全性と、使用中に故障するボイドだらけスタックを分ける。測定連鎖は標準:既知電荷に校正された結合コンデンサ、試験対象を定格電圧以上でストレス。

バスバープログラムに対し、検収試験は通常:PDIV までランプし記録;定格電圧に保持し <10 pC を検証;降下させ PDEV を記録。サンプル試験は生産にとって良好だが、設計認定は生産と同じ工具・材料を持つ代表部品に対し行われるべき。

10. Creepage and Clearance as PD Inputs

表面 PD は、バルク絶縁と同じだけ沿面距離・空間距離に従う。汚染、湿度、標高はすべて有効沿面経路を短縮し、汚れた表面での PD は速やかにトラッキングへ――フラッシュオートで終わる炭化導電痕。

当社の沿面・空間距離設計ガイダンスは寸法規定則を扱い;PD アングルは検証:清潔な実験室環境でなく、予想環境条件(湿度、または汚損クラス)下での表面 PD 試験。屋外または部分密閉バスバーにとって、その差は本質的。

11. Materials: What Each Dielectric Contributes

PET フィルムが主力:高絶縁耐力(通常 >200 V/µm)、低コスト、清潔なラミネーション。Nomex は熱余裕と機械的靭性を加え、より高温クラスとサイクル Duty に重要。DLF(二層フィルム)と他の積層体は、同じ方法でコストと PD 余裕をトレードオフ。

材料選択が天井を決め;工程がそれに到達できるかを決める。並のフィルムスタックでもボイドフリーラミネートされれば、ボイドのある高級フィルムスタックより長持ちする。だからこそ PD の真の決定は材料仕様だけでなく工程管理。

Partial discharge test of a laminated busbar per IEC 60270 with PDIV/PDEV recording

12. Specifying PD-Free Duty on Your Next PO

高電圧バスバーを市場に出すとき、PD 要件は後の会話でなく仕様書に属する。最小三項目:IEC 60270 に従う PDIV・PDEV 目標、定格電圧での <10 pC 限界、試験法の明記(Duty に応じ AC および/または DC)。

工程期待――ボイドフリーラミネーション、縁半径、必要ならシールド――と文書を加えよ:設計認定ごとの PD 試験報告、加えて生産からのサンプル記録。そのファイルこそが、出荷されるバスバーと性能を発揮するバスバーを分けるもの。

13. SHANYUAN's PD Testing Capability

SHANYUAN は、ボイド管理ラミネーションとロット別誘電体試験を備えた積層バスバーを生産し、CoC 付き hipot・絶縁抵抗・導通記録を含む。より高電圧プログラムに対しては、生産工具を切る前にスタック――層数、フィルム種、縁延長――を PD 目標に対し認定する。

電圧クラス、誘電体要件、試験限界を図面と共に送付されたい;当社エンジニアがスタックと認定計画を確認し、1 営業日以内に返答する。

14. Testing in Production: Sample vs 100% PD Screening

PD 試験は hipot より遅く高価なため、生産スクリーニングは通常サンプルベース――定義された頻度、例えばロットまたはシフトあたり 1 部、完全 PDIV/PDEV シーケンスを通し、一方各部は日常 hipot を受ける。サンプル記録がその後ロットを固定する。

罠は工程ドリフト:工具変更、新フィルムロット、ラミネーション温度シフトが、日常試験をトリップせずボイドを再導入しうる。修正はサンプル PDIV の管理図――開始電圧がロット間で這い下がるなら工程が動いたことであり、界での故障の後でなく前に調査を始める。

15. Designing for Assembly and Handling

PD フリーバスバーはプレスを出た後に敗北しうる。取扱いが絶縁を擦過;組立工具が終端のフィルムを欠き;取付点で深く打ち込まれたネジが局部応力集中になる。設計段階はある程度の乱用を仮定し、それに余裕を構築すべき:取扱域のより厚いフィルム、保護縁カバー、トルク・工具に関する明確な組立指示。

高電圧プログラムに対し、当社図面は取扱・組立制約を電気要件と同じシートに指定する――PD フリーで到着した部品が、据付後も PD フリーであって初めて有用だから。

16. When to Specify PD-Free Duty

すべてのバスバーが PD フリー設計を要するわけでない。約 1 kV 未満では、ボイド関連 PD が寿命制限メカニズムになることは稀――熱的・機械的問題が支配的。PD フリー仕様の論拠は 1 kV 超で強まり、3.3 kV 以上、コンバータ・MV Duty、そして絶縁が電圧クラスに対し薄い箇所では不可欠になる。

購買者への決定則:系統電圧が 1 kV 超、または Duty がコンバータ給電 DC(スイッチング過渡を見る)なら、PDIV/PDEV と 10 pC 限界を仕様に入れよ。それ未満では、PD 試験コストが意味あるものを何も買わないかもしれない。

17. The Cost of PD Testing vs the Cost of Failure

PD 試験はコストを加える――装置、時間、工学レビュー――そして予算問いは正当。それが防ぐ故障は滅多に壮観でない:工場での hipot トリップでなく、界での途中寿命誘電体破壊、保証請求、停止事象、そして誰も試験しなかったボイドに終わる根本原因調査。

生産プログラムにとってコスト比較は明白:サンプル PD 試験は単価に小さなパーセントを加える一方、コンバータまたは ESS ラックでの界故障は桁違いに高くつく。仕様決定はリスク決定であり、電圧が正当化する箇所はいずれも、リスクは試験に有利に非対称。

18. Reading a PD Test Report

PD 試験報告は読めて初めて有用。必須事項:試験回路・校正(IEC 60270 に従う)、背景雑音床、ランプ率付き PDIV、定格電圧での pC 値、降下時 PDEV、環境条件(温度、湿度、標高)。

二つの危険信号:雑音床が 10 pC 限界に近く合格を無意味にするもの、そして PDEV なしに PDIV だけを引用する報告。供給業者の報告がいずれかを欠くなら完全試験記録を求められたい――答えが試験が本物だったかを教える。

19. Altitude and the PD Margin

1,000 m 超では空気密度が下がり、その絶縁破壊強さも下がる――いくつかの指針では 100 m あたり約 1%。海抜で設定された PD 余裕は高地サイトで静かに縮み、薄い空気での表面放電が工場試験の予測より早く始まる。

高原地域に据付けられる高電圧バスバーに対しては、動作電圧をディレートするか、誘電体を厚くするか、標高補正に従い沿面を延長されたい。試験報告の PDIV/PDEV 数値は試験標高で測定されたもの;据付標高は仮定でなく独自チェックを要する。

FAQ

Frequently asked questions

What causes partial discharge in laminated busbars?
PD starts where the electric field exceeds the material's withstand: internal voids from trapped air or outgassing, sharp conductor edges, and triple points where conductor, insulation and air meet.
What is a good PDIV for a medium-voltage busbar?
A practical target is PD inception suppressed below 10 pC at rated voltage. For MV planar bus structures, demonstrated PDIV values range from roughly 11.6 kV rms (10 kV module laminate) to 18-20 kV DC (16 kV-rated planar bus).
How is PD tested on busbars?
Per IEC 60270: the test object is stressed through a calibrated coupling capacitor, PDIV is recorded on the way up, discharge magnitude held at rated voltage, and PDEV recorded on the way down. DC duty requires DC PD testing, not only the AC test.
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