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Low-Inductance Busbar Design: Principles & Layout Rules

Stray loop inductance is what turns a clean switching edge into a voltage spike that stresses every semiconductor in the inverter. This guide explains why laminated planes reach nanohenry levels, how far the design rules take you, and where FEM optimization earns its keep.

なぜ浮遊インダクタンスがスイッチングループを支配するか

パワースイッチが、例えば on から off へ転流するとき、ループを流れる電流は流れ続けたがる——水管の中の水のように。その電流が今開いたスイッチに出会うと、それに衝突しデバイス両端に電圧スパイクを生む。関係はおなじみの V = L × di/dt:ループインダクタンス L に電流変化率を掛けたもの。

ループインダクタンスが高いほど、半導体が耐えるべきサージは高くなる。例えはウォーターハンマー:蛇口を閉めるとき液体の速度が過圧へ変わる。オーバーシュートに加え、高ループインダクタンスは電磁妨害を駆動する。同じ磁束が近傍導体に結合するから。

なぜこれが毎年ますます重要になるか? SiC スイッチは接合温度が 175 °C 付近、シリコンの 150 °C に対し、より速くスイッチングする;速いスイッチングこそが V = L × di/dt スパイクを倍増させるもの。ディスクリート SiC MOSFET は定格電力に達するため並列されることも多く、並列アレイ全体にわたるループインダクタンスのさらに厳密な管理を要求する。浮遊ループが電気問題を熱問題に結合する:オーバーシュートがチェーン内の各デバイスに過大設計マージンを強い、SiC アップグレードが買おうとした電力密度利得を塞ぐ。

高ループインダクタンスはまたコンバータがどれだけ速くスイッチングできるかに天井を作る。半導体の安全動作領域に留めるため、設計者はスイッチングエッジを遅くするかスナバを追加し、どちらの選択も速いデバイスのために買われた効率そのものを犠牲にする。これが初期にインダクタンスを無視する隠れたコスト:動作はするが電力段全体のディレーティングを強いる DC リンク。応用文脈は当社のインバータバスバーページ、半導体側視点はSiC と IGBT の DC リンクバスバー動向を読まれたい。

Low-inductance laminated busbar assembly
Opposing parallel planes spaced under 100 µm deliver the lowest practical loop inductance.

なぜ積層プレーンが最低インダクタンスを与えるか

導体のインダクタンスは形状と対向電流経路の近接に依存する。利用可能な最低インダクタンス形状は平行プレーンであり、それはまさに積層バスバーそのもの:薄い誘電体で隔てられた平坦な正負導体。インダクタンスを最小化するため、導体は極端に近づけられ、一部設計では絶縁距離 100 µm 未満。

同じ導体断面、長さ 1 m、ギャップ 1 mm;桁違い比較は鮮烈:

構成ループインダクタンス
丸線対、1 mm 離間≈ 0.4 mH
等価積層バスバー、同断面、ギャップ 1 mm≈ 50 nH
同バスバーにハイエンド絶縁、ギャップ 0.2 mm20 nH 未満

二つの物理効果が高周波で数値を形作る。表皮効果が交流を各導体の外表面へ押しやり、近接効果が対向方向の電流を対向プレーンの対向面へ引き寄せる。積層バスバーではこれらの効果が有利に働く:対向プレーンが互いの界を利用し、磁束はギャップでほぼ打ち消す。緩い丸線にはそのような打ち消しがなく、それが同じ断面が 0.4 mH から約 50 nH へ下がる真の理由。100 µm 未満の間隔はマーケティングでなく機構:ギャップを詰めると磁束が見るループ面積が縮む。

約 60–75 kW 未満では、コンパクトなパワー PCB が制御と電力を一枚基板に統合できる;それ以上ではパワーエレクトロニクス積層バスバーが好ましい DC リンク相互接続——低ループインダクタンスを耐久性・耐振性と共に届けるから。本格的パワーエレクトロニクスの目標域はミリヘンリー級でなくナノヘンリー級。

実務には、実バスバーは決して二つの完璧な矩形でない。端子窓、ボルト穴、千鳥層がプレーン重なりを壊し、各破れが局所的なループ面積上昇。だからこそ形状作業は直線走行でなく最初に端子で行われる:平坦な 50 mm のプレーンはほとんどインダクタンスを寄与せず、開いた磁気ギャップを持つ屈曲端子は予算の半分を食いうる。磁束を打ち消す同じ平行プレーンスタックは層間に電流も分担させる;層数が定格をどう変えるかは電流容量チャートを参照。スイッチングセル図面をお送りいただくとき、端子とコンデンサ界面が当社が最初に見る箇所。

Diagram of parallel-plane geometry versus a round-wire loop
Round wires create big loop area; laminated planes cancel it.

転流ループの経験則スケーリング規則

転流回路の浮遊インダクタンスは、表皮効果、相互インダクタンス、転流経路長、導体間隔、バスバーの分割構造に影響される。二つの経験則は形状を超えて通用するため暗記する価値がある:

  • 転流回路の長さを倍にすると、浮遊インダクタンスは約 30% 上昇。
  • 転流導体間の絶縁厚または間隔を倍にすると、浮遊インダクタンスは約 80% 上昇。

間隔は長さよりはるかに効く。つまり対向プレーンを可能な限り近づけよという別の言い方。だがレイアウト非対称性、部品配置、積層構造のため、転流ループはほぼ常に不平衡。

不平衡はどこから来るか? レイアウト非対称性、部品配置、積層順序がすべてループ周りに電流密度を押しやり、一方の転流経路が他方より多くのインダクタンスを見る。不平衡は主回路へ伝播し、ありがちな応急手当は、不平衡電圧と熱ストレスを抑える追加スナバ回路とより大きなヒートシンク。どちらも、最初からループが平衡していれば払わずに済んだコストとサイズのペナルティ。

同じ不平衡論理がモジュール並列時に当てはまる。並列の二つのスイッチがわずかに異なるループインダクタンスを見れば、電流を不均等に分担する:低インダクタンス経路がより多く担い、より熱くなり、より速く経年し、システム定格を決める。平衡スタックと対称端子配置こそが、並列デバイスが計画通り分担することを可能にする。これがまた、バスバーレイアウトレビューを機械レイアウト凍結後に行えない理由;二者は同一問題。当社の実務はループバランスを明示的な DFM 変数として扱うこと:部品配置を並べ替え、層順を反転し、工具段階前にシミュレーションで電流分担をチェック。

Inverter DC-link busbar with capacitor bank
Commutation-loop length and layer spacing are the two levers that scale inductance.

FEM 最適化:ループインダクタンスを 12 nH から 5 nH へ

物理試作でのインダクタンス測定は専門実験装置・繊細なセットアップ・少なくとも一回のビルドを要し、小さな形状変化が数値を大きく動かすため、容易に修正可能なテストサンプルの構築はほぼ不可能。有限要素シミュレーションは物理サンプルを要しない:

  • バスバーの 3D モデルだけを構築;半導体とコンデンサはモデル化しない。
  • コンデンサを短絡ブロックへ置き換え、電流が最低インピーダンス経路をたどるようにする;ソルバは高周波で近接効果・表皮効果を考慮。
  • 半導体接続点にインダクタンスプローブを配置。
  • 磁界プロットを読む;インダクタンスは磁束に比例し、ソルバは MHz まで周波数をスイープするため、スイープは実際のスイッチング周波数とスロープに一致させねばならない。
  • 最高磁束域を反復する。並走ランが電流分布と熱挙動を同時に評価。

二つの詳細が効く。コンデンサを短絡ブロックへ置き換えることは、ソルバに DC 端子間の最低インピーダンス経路をたどらせる——それはまさにあなたが気にする高周波転流電流経路。そして周波数を MHz までスイープすることは、磁束が表皮効果・近接効果を通じ強い周波数依存性を持つため重要;単一周波数のソルバランは一つの数値を与えるだけで、実際のスイッチングスロープに合わせたスイープはデバイスが実際に見る数値を与える。

典型的な最適化ループ(5 kHz、プローブ電流 1 A の例ケース)はこうなる:

設計ステップ総ループインダクタンス
ベースライン、屈曲端子、開ギャップ12.0 nH
接続ブッシング付きフラット端子、開ギャップ縮小9.2 nH
端子間重なり増加、磁束打ち消し4.5 nH

結果:高速反復アプローチで 63% 削減、5 nH 未満で着地。最大の寄与は半導体接続端子、開ループギャップ、コンデンサ接続から来た。教訓は任意の転流経路へ移転可能:最大のインダクタンスはプレーンのバルクでなく界面に在る。コンデンサリード、屈曲端子、バスバーtoモジュールボルトが各々ループを開き;平坦で重なり短い界面が再び閉じる。DC リンクコンデンサをバスバーに直接はんだ付けするのはこの最も積極的版であり、それがコンデンサ統合型DC リンクバスバーアセンブリが存在する理由。

当社が全設計で適用するレイアウト規則

  • 各端子・バスバー界面で開ループ磁気ギャップを最小化;可能な限り正負プレーン重なりを増やす。
  • 必要絶縁レベルを保証しつつ、転流ループ絶縁距離を可能な限り小さく。
  • 許容できる熱と温度上昇を保証しつつ、レイアウトを可能な限りコンパクトに。
  • 部品配置と導体スタック順序を通じ転流ループを平衡化。
  • DC リンクコンデンサをスイッチ端子に可能な限り近く実装;長い個別コンデンサリードは純粋な追加インダクタンス。

各規則の背後には故障モードが在る。端子の開いた磁気ギャップは電流が迂回を強いられるループ;追加重なりがそれを打ち消す。プレーン間の薄い絶縁はループ面積を縮めるが、PD 設計マージンを下回ると部品は電圧下でもはや安全でなく、だからこそ高電圧設計は部分放電設計マージンを並行チェックされる。コンパクトレイアウトはループ長を切るが、ループを詰めると熱も閉じ込め、だからこそ熱チェックをバスバー熱マネジメントで同時に実行する。平衡が効くのは、不平衡ループが並列デバイスの電流分担を不均等にし、最悪の並列デバイスが定格を決めるから。

Laser cutting of a conductor profile
Terminal placement and loop symmetry are fixed at tooling — review them before cutting.

低インダクタンス設計が製品を決める箇所

バッテリ EV のトラクションインバータでは、浮遊インダクタンスが電気・磁気・熱問題を互いに結合する:過大設計マージンを強い、電力密度利得を塞ぎ、部品選定・定格・スイッチング周波数・温度上昇に影響する。EV パワートレインインバータと産業モータ駆動で、まさにその理由で DC リンクがワイヤハーネスでなく積層バスバーとして構築される。二者のアプローチは当社のバスバー vs ケーブルハーネスガイドで比較。

約 60–75 kW 未満では、コンパクトなパワー PCB が制御と電力段を一枚基板に統合し、積層バスバーは不要。その帯域を超えて、トラクションインバータ、DC/DC コンバータ、100–500 A セグメントでは、DC リンク相互接続がループインダクタンスを製品仕様パラメータにする箇所。このアーキのコンデンサ統合版は、コンデンサをスイッチ近くにという規則を極端化する:DC リンクコンデンサをリードにボルト留めでなくバスバーに直接はんだ付けし、回路から最後の長いループ面積を除去する。各リリース DC リンクバーは、当社の内製積層バスバー試験プロセスの下で hipot・絶縁抵抗・導通チェックに合格し、ロット記録は要求に応じ供給される。

この境界を押すもう一つのトレンドは電圧。トラクションで DC バス電圧が 800 V 以上へ登り続け、スイッチで得られる di/dt を上げ、ループ内の各ナノヘンリーへの許容度を縮める。400 V で快適だった DC リンクは、SiC アップグレード前でさえ 800 V で再検討に値する。

電流・スイッチング周波数・di/dt・コンデンサと半導体位置を添えてスイッチングセル図面をお送りいただければ、工具前にインダクタンスと熱レビューを当社のバスバー DFM レビューサービスの一環として実行する。本ガイドの数値——長さ倍増で 30%、ギャップ倍増で 80%、50 nH 対 0.4 mH——は量産級設計からの参照値;仕様でなく問題のスケールとして扱い、最後の 10% は FEM ループに閉じさせよ。新プログラムの開始チェックリストは積層バスバー設計ガイドに在る。またはレイアウトを携えて当社エンジニア窓口へ直行。

13+2012年からの実績年数
1–6+導体層数
~1000 A定格電流
1 day技術回答
FAQ

Common questions

何層の導体まで製作できますか?
1層から6層以上まで、ご指定のスタックで製作します。層数、端子配置、取付け構成はすべて図面で定義し、製治具着手前にDFMでレビューします。
SHANYUAN のバスバーは何Aまで流せますか?
定格は用途ごとに設計し、約1000 Aまで対応します。連続電流とピーク電流に熱余裕を見て断面を決めます。出発点として電流容量表をご参照ください。
積層バスバーの見積りには、どのような情報が必要ですか?
図面(PDFまたはDXF)、または既存サンプルの写真、必要な定格電流と電圧クラス、導体層数、端子形状、推定年間数量、用途をお知らせください。仕様がそろえば、技術チームは通常1営業日以内に回答します。

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